Aluno:______________________________________________________ CPF Nº:___________________

 

 

1.O circuito sequencial da FSM mostrado na Fig.1 tem uma entrada E e uma saída Z. Considere que o estado inicial da FSM EABC é igual `a representação BCD do segundo dígito mais significativos do CPF(CPF par) e EABC é igual `a representação BCD do segundo dígito menos significativos do CPF(CPF ímpar) e RESET igual a 0. Então, determine os estados e saídas da FSM depois de 5 pulsos de clock.
Solução

 

 


Fig.1

 

 

 

 


Fig.1

 

 

 

 

Valor da questão = 5

Cada coluna completamente correta = 1

 

 

 

2. A arquitetura simplificada do processador da Fig.2 tem a posição da memória 00H gravada com a representação BCD( A7A6A5A4A3A2A1A0 ) dos dois dígitos menos significativos do CPF. Considere que o endereço da memória A5A4A3A2A1A0 está gravado com a representação BCD dos dois números mais significativos do CPF. Após a execução da sequência de microoperações mostradas, indique, em binário, o conteúdo dos registradores PC, IR, CI, ACC e MAR depois da execução da última microoperação. Considere que todos os demais registradores inicialmente estão resetados.
Solução

 

 

Clock
Microoperação
Comentários
1
TPC
  
2
E, R/W`, TB
  
3
IPC
  
4
TIR
  
5
E, R/W`, W
 
6
R, WA
 
7
R, WA
 
8
C
  
9
I
  
10
R, WA
 
Fig.4

 

 

 

 

Seu CPF:___________________________

Representação BCD dos dois número mais significativos do CPF =___________________________(bin)

Representação BCD dos dois números menos significativos do CPF = ________________________(bin)

Conteúdo da locação de memória 00H = ______________________________(bin)

 

PC = ____________(bin)_ IR = _____________(bin)_CI = ____________(bin)_ACC = ___________(bin)_MAR = ____________(bin)

 

 

 

Valor da questão = 5

Cada item completamente correto = 1

 

 

 

 

 

Atualizada em 19/09/23

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